VCO 주기마다 전하가 전달되는 구조의 루프필터를 가진 위상고정루프
- Abstract
- 본 논문에서는 높은 출력주파수를 가진 전압제어발진기(VCO) 출력 신호가 루프필터의 입력 신호로 사용되는 구조를 제안하였다. 제안된 구조는 더 안정적으로 동작하며 기준 주파수 스퍼를 크기를 억제 할 수 있다.
제안한 위상고정루프는 0.18μm CMOS 공정을 사용하여 HSPICE 시뮬레이션을 통해 결과를 검증하였다.
- Issued Date
- 2013
- Awarded Date
- 2013. 2
- Type
- Dissertation
- Publisher
- 부경대학교
- Affiliation
- 부경대학교 대학원
- Department
- 대학원 전자공학과
- Advisor
- 최영식
- Table Of Contents
- Ⅰ. 서론 1
Ⅱ. 위상고정루프의 기본 이론 3
2.1 위상고정루프의 구조 및 이론 3
2.2 기본 블록들의 동작특성 5
2.2.1 위상 주파수 검출기 5
2.2.2 전하펌프와 루프필터 8
2.2.3 전압 제어 발진기 10
2.2.4 주파수 분주기 10
2.3 전하펌프 PLL의 선형적 분석 11
Ⅲ. 제안한 위상고정루프 설계 15
3.1 PLL with Fvco-sampled 1st-order LF 구조 15
3.2 PLL with Fvco-sampled 2nd-order LF 구조 23
3.3 위상 주파수 검출기(Phase Frequency Detector) 27
3.4 전하펌프(Charge Pump) 29
3.5 전압 제어 발진기(Voltage Controlled Oscillator) 30
3.6 주파수 전압 변환기(Frequency Voltage Converter) 32
3.7 주파수 분주기(Divider) 34
Ⅳ. 시뮬레이션 결과 35
4.1 시뮬레이션 결과 35
4.1.1 PLL with Fvco-sampled 1st-order LF 35
4.1.1 PLL with Fvco-sampled 2nd-order LF 37
4.2 레이아웃 40
4.2.1 PFD 40
4.2.2 Charge Pump 41
4.2.3 Voltage Controlled Oscillator 42
4.2.4 Frequency to Voltage Converter 43
4.2.5 LF Control(OR, NOR, NMOS) 43
4.2.6 Divider 44
4.2.7 Total PLL 45
4.2.7.1 PLL with Fvco-sampled 1st-order LF 45
4.2.7.1 PLL with Fvco-sampled 2nd-order LF 46
Ⅴ. 결론 47
참고문헌 48
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